About this Course
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100% 온라인

지금 바로 시작해 나만의 일정에 따라 학습을 진행하세요.

유동적 마감일

일정에 따라 마감일을 재설정합니다.

중급 단계

완료하는 데 약 15시간 필요

권장: 4 weeks of study, 8-12 hours/week...

영어

자막: 영어

귀하가 습득할 기술

Writing Code in VerilogSimulating FPGA DesignsDesigning FPGA LogicDesigning Test BenchesWriting code in VHDL

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유동적 마감일

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강의 계획 - 이 강좌에서 배울 내용

1
완료하는 데 11시간 필요

Basics of VHDL

10개 동영상 (총 48분), 2 readings, 7 quizzes
10개의 동영상
Why Learn VHDL?1m
FPGA Design Flow3m
Intro to VHDL: Finite State Machine3m
How to speak VHDL, first phrases6m
VHDL Assignments, Operators, Types3m
VHDL Rules and Syntax, Interface Ports3m
VHDL in ModelSim: Download and Install3m
VHDL in ModelSim: Adding to your Toolkit6m
Submitting VHDL Programming Assignments11m
2개의 읽기 자료
Misson 2-001: Week 1 Readings2h
Files for Week 1 Programming Assignments10m
2개 연습문제
VHDL Find the Code Errors30m
Module 1 Quiz30m
2
완료하는 데 12시간 필요

VHDL Logic Design Techniques

10개 동영상 (총 52분), 2 readings, 6 quizzes
10개의 동영상
Combinatorial Circuits4m
Synchronous Logic: Latches and Flip Flops4m
Synchronous Logic: Counters and Registers6m
Buses and Tristate Buffers3m
Modular Designs: Components, Generate and Loops in VHDL3m
Test Benches in VHDL: Combinatorial8m
Test Benches in VHDL: Synchronous5m
Memory in VHDL7m
Finite State Machines in VHDL8m
2개의 읽기 자료
Week 2 Readings2h
Files for Week 2 Programming Assignments10m
1개 연습문제
Module 2 Quiz30m
3
완료하는 데 7시간 필요

Basics of Verilog

9개 동영상 (총 92분), 2 readings, 6 quizzes
9개의 동영상
Your First Verilog phrase11m
Verilog Rules and Syntax; Keywords and Identifiers; Sigasi/Quartus editing12m
Verilog Statements and Operators16m
Verilog Modules, Port Modes and Data Types10m
Verilog Structure10m
Testing with ModelSim5m
Verilog Evaluation11m
Submitting Verilog Programming Assignments10m
2개의 읽기 자료
Week 3 Readings1시 10분
Files for Week 3 Programming Assignments10m
2개 연습문제
Verilog Find the Errors20m
Module 3 Quiz30m
4
완료하는 데 10시간 필요

Verilog and System Verilog Design Techniques

10개 동영상 (총 48분), 2 readings, 6 quizzes
10개의 동영상
Combinatorial Circuits5m
Synchronous Logic: Latches and Flip Flops3m
Synchronous Logic: Counters and Registers5m
Buses and Tristate Buffers3m
Modular Design in Verilog3m
Testbenches in Verilog7m
Testbenches in Verilog II2m
Memory with Verilog4m
Verilog Finite State Machines7m
2개의 읽기 자료
Week 4 Readings15m
Files for Week 4 Programming Assignments10m
1개 연습문제
Module 4 Quiz30m

강사

Avatar

Timothy Scherr

Senior Instructor and Professor of Engineering Practice
Electrical, Computer, and Energy Engineering
Avatar

Benjamin Spriggs

Lecturer and Scholar of Engineering Practice
Electrical, Computer, and Energy Engineering

콜로라도 대학교 볼더 캠퍼스 정보

CU-Boulder is a dynamic community of scholars and learners on one of the most spectacular college campuses in the country. As one of 34 U.S. public institutions in the prestigious Association of American Universities (AAU), we have a proud tradition of academic excellence, with five Nobel laureates and more than 50 members of prestigious academic academies....

자주 묻는 질문

  • 강좌에 등록하면 바로 모든 비디오, 테스트 및 프로그래밍 과제(해당하는 경우)에 접근할 수 있습니다. 상호 첨삭 과제는 이 세션이 시작된 경우에만 제출하고 검토할 수 있습니다. 강좌를 구매하지 않고 살펴보기만 하면 특정 과제에 접근하지 못할 수 있습니다.

  • 수료증을 구매하면 성적 평가 과제를 포함한 모든 강좌 자료에 접근할 수 있습니다. 강좌를 완료하면 전자 수료증이 성취도 페이지에 추가되며, 해당 페이지에서 수료증을 인쇄하거나 LinkedIn 프로필에 수료증을 추가할 수 있습니다. 강좌 콘텐츠만 읽고 살펴보려면 해당 강좌를 무료로 청강할 수 있습니다.

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